ナノ秒エキシマパルス：PFNループインダクタンスの限界

ナノ秒エキシマパルス：PFNループインダクタンスの限界

抽象

立ち上がり時間が25 ns～50 ns、ピーク電流が10 kA～20 kAの場合、パルス整形回路は減衰RLC回路として動作し、ループインダクタンスのナノヘンリーごとに波形が整形されます。インダクタンスは、コンデンサに10 nH、スイッチバスに15 nH、磁気巻線に20 nH、ケーブルに5 nHと分布しています。その結果、電流オーバーシュートが30%以上発生し、リンギングテールによって各ショットごとにコンデンサが疲労します。

はじめに

エキシマパルス形成回路は、ガス放電に適合する、立ち上がりが速く、頂部が平坦な電流パルスを生成することを目的としている。立ち上がり時間が25ナノ秒から50ナノ秒、ピーク電流が10キロアンペアから20キロアンペアの場合、回路全体はRLC共振回路として動作する。

寄生ループインダクタンスのナノヘンリー単位のすべてが波形形状に影響を与える。50 nHのループインダクタンスは10 kHzでは目に見えないが、5 MHzから20 MHzでは電流波形を完全に変形させる。

慣例として、そのインダクタンスは、それ以外はクリーンな設計に対する小さな補正として扱われる。実際には、それはアセンブリ全体に分散され、各セグメントはリンギングエネルギーの異なる割合を寄与する。

一般的な分割では、コンデンサに10 nH、スイッチバスに15 nH、磁気ステージ巻線に20 nH、レーザーヘッドへのケーブルに5 nHの容量が配分されます。このとき、パルスはオシロスコープ上では滑らかに見えますが、その高周波成分によってコンデンサの電圧は設計動作電圧より10%～20%高くなります。

2. コアメカニズム

2.1 ループインダクタンスと共振周波数

ループインダクタンス、ステージ容量、およびループ抵抗は、固有振動数が次のようになる減衰直列回路を形成する。

f_n = 1 / (2π × √(L_loop × C_stage))

ここで、f_nはヘルツ単位の固有振動数、L_loopはヘンリー単位の全ループインダクタンス、C_stageはファラッド単位のステージ容量である。

20 nFの段と100 nHのループインダクタンスの場合、固有振動数は3.6 MHzです。ループインダクタンスを400 nHに上げると、固有振動数は1.8 MHzに低下します。

減衰比は、その振動のうちどれだけが残存するかを決定します。

ζ = R / (2 × √(L_loop / C_stage))

ここで、ζは減衰比、Rはオーム単位の全ループ抵抗、L_loopはヘンリー単位のループインダクタンス、C_stageはファラッド単位のステージ容量である。

ほとんどのエキシマネットワークは0.3～0.7の範囲に収束し、これは減衰が不足している状態である。そのため、電流は安定する前に必ずフラットトップターゲットを通過する。

2.2 電流オーバーシュート

減衰不足ループにステップ電圧を印加すると、電流は定常状態の値を超えて増加する。オーバーシュート率は減衰比に従う。

I_overshoot / I_ss = e^(−πζ / √(1 − ζ²))

ここで、I_overshootはピーク電流（アンペア）、I_ssはフラットトップ値（アンペア）、ζは減衰比である。

ζが0.35の場合、オーバーシュートは30.9%になります。したがって、16kA用に設計されたネットワークは、最初の30nsで20.9kAを供給し、これはスイッチとコンデンサの両方の瞬時電流定格を超えています。

スイッチは最も大きな影響を受ける。接合部の温度は、ショットごとに10ナノ秒の間、平均値をはるかに上回る急上昇を示し、こうした急上昇が何百万回も繰り返されることで、オン抵抗と熱抵抗が上昇する。

2.3 コンデンサにおける電圧のピーク

電流ピーク時のコンデンサ電圧には、バス電圧に加えて誘導性項が含まれる。

V_cap(t) = V_bus + L_loop × dI/dt

ここで、V_cap(t)は瞬時コンデンサ電圧（ボルト）、V_busは充電電圧（ボルト）、L_loopはループインダクタンス（ヘンリー）、dI/dtは電流勾配（アンペア/秒）です。

高速エキシマ段では、オーバーシュートピークの傾斜が10 kA/nsに達します。バス電圧は誘導性成分とコンデンサに分割されるため、部品全体のピーク電圧はV_busより5%～8%高くなり、15 ns～30 ns持続します。

30kVのコンデンサは通常、短時間であれば33kVの定格電圧を持つように設計されている。30kVの母線に2kVのピーク電圧がかかると、コンデンサにかかる電圧は32kVに達する。これは過渡定格の範囲内ではあるが、誘電体が必要とする寿命マージンを超えている。

2.4 傾斜増幅とゲート結合

ピークが発生すると、スイッチにかかる電圧の傾斜が上昇する。

dV/dt_max = ΔV / t_rise

ここで、dV/dt_maxはボルト/秒単位のピーク傾斜、ΔVはボルト単位の過渡過電圧、t_riseは秒単位の立ち上がり時間である。

2 kVのピーク電圧が15 nsのエッジで印加されると、傾斜は133 V/nsになります。出力容量が50 pFのSiC MOSFETでは、これがゲートノードへの6.65 Aの変位電流に変換されます。5 Ωのゲートインピーダンスでは、電圧変動は33 Vに達し、ゲート定格をはるかに超えます。

コンデンサ側では、同じ傾斜が10MHz以上の周波数で誘電体を励起し、空間電荷がサイクル間で再分布する時間がなくなってしまう。そのため、本来は直流定格の範囲内であるはずの部分で部分放電が始まる。

2.5 鳴る尾

メインパルスの後、ループインダクタンスに残ったエネルギーは、コンデンサと数マイクロ秒間リンギングします。各サイクルでは、印加されたパルスに対して電圧反転が発生します。

V_reversal ≈ V_peak × e^(−πζ)

ここで、V_reversalは最初の反転振幅（ボルト）、V_peakはピークパルス電圧（ボルト）、ζは減衰比である。

ζが0.4のとき、反転はピーク値の28%に達します。この反転はスイッチ本体のダイオードとコンデンサの誘電体に同時に負荷をかけ、6kHzではメンテナンス間隔の間に5万回繰り返されます。

メインパルスが既に発射され、レーザーが発振を終えているため、テール部分は簡単に省略できます。その累積疲労はメインパルスの累積疲労と同程度です。

図1 — オーバーシュートはζ0.1で73%からζ0.6で9.5%に低下するため、ζ0.35での16kA設計は20.9kAに達します。

3. エンジニアリング上の課題

問題点1：オーバーシュートによりスイッチが過電流状態になる

オーバーシュートにより、最初の20ナノ秒から50ナノ秒の間、ソリッドステートスイッチにはフラットトップ値よりも30%多い電流が流れます。スイッチの瞬間過電流定格は有限です。

局所的な接合部温度が10ナノ秒の間、平均値をはるかに上回る急上昇を示し、数百万回のパルス印加後には接合部が劣化する。オン抵抗と熱抵抗の両方が上昇し、その故障原因はこれまでモデル化されていなかったインダクタンスにあることが判明する。

問題点2：コンデンサの過渡定格を超えるピーク値

高電圧コンデンサは通常、直流定格電圧の約10%増しの過渡定格電圧を備えているため、30kVの部品は短時間であれば33kVの電圧を保持できます。2kVから4kVのピーク電圧が15nsから30nsの間発生すると、この許容電圧のほとんどが消費されます。

すると、誘電体はパルスごとに部分放電状態に入る。侵食は微細な亀裂として蓄積され、絶縁抵抗が変動し、部品は一見ランダムに見えるパターンで故障するが、これは制御不能なループインダクタンスに直接起因する。

問題点３：傾斜結合によるスイッチタイミングの劣化

133 V/ns のとき、SiC MOSFET の出力容量はゲートノードに 6.65 A の変位電流を発生させ、5 Ω のゲートインピーダンスによってそれが 33 V の電圧変動に変換されます。

この変動はスイッチのタイミングを狂わせ、誤作動や部分的なオフを引き起こし、下流の磁気段にジッターを送り込みます。出力ではノイズとして現れ、その発生源はループインダクタンスにあります。

ペインポイント4：疲労経路としての尾部の鳴り

メインパルスが終了し、レーザーが発射された後、テール部分は無視しやすい。しかし、それでも発射のたびにコンデンサに電圧反転が生じ、スイッチを通して電流反転が発生する。

6kHzにおいて5万パルスの維持間隔で発生する累積疲労は、テールパルスによる疲労とメインパルスによる疲労に匹敵する。リンギングを考慮しない寿命推定では、ストレスの半分を見落としてしまう。

4. 設計手順

戦略1：ループインダクタンスの上限値を立ち上がり時間から設定する

目標立ち上がり時間、ステージ容量、および減衰比から最大ループインダクタンスを導出する。

L_loop_max = t_r² / (2 × C_stage × ζ²)

ここで、L_loop_max はヘンリー単位の上限値、t_r は秒単位の目標立ち上がり時間、C_stage はファラッド単位のステージ容量、ζ は減衰比です。20 nF、30 ns の立ち上がり時間、ζ 0.4 の場合、上限値は 140 nH です。

天井内にバスバー、スイッチパッケージ、ケーブル類を収納します。レイアウト段階で各セグメントに割り当てを行い、その後アセンブリの寸法を測定します。

戦略2：コンデンサを切断し、ESLを切り替える

ESLが30 nH以下のコンデンサと、ソースインダクタンスが5 nH以下のスイッチを選択してください。ラジアルリードとネジ端子 ドアノブコンデンサ ループ内のコンデンサの割合を小さく保つ。

スイッチとコンデンサ間のケーブルハーネスを積層バスバーに交換することで、往復経路間の相互インダクタンスを打ち消すことができます。

戦略3：ループを抑制する

低インダクタンスを追加する 厚膜抵抗器 ステージと直列に0.5Ω～2Ωの抵抗器を接続し、ζを0.5または0.6に上げ、オーバーシュートを16.3%～9.5%に抑える。抵抗器自体の抵抗値は10nH～30nH程度に抑え、問題が悪化しないようにする必要がある。

フル電圧プロトタイプで減衰特性を確認してください。ループ抵抗がモデルで使用されている値と一致することを確認するには、測定を行うしかありません。

戦略4：ピークを抑える

〜を置く 高速回復ダイオード スイッチングダイオードと逆直列に接続し、オーバーシュートを規定レベルに抑制します。逆回復時間が35ナノ秒以下で、かつ回復電荷が十分に低く、吸収すべきオーバーシュート領域に電流を注入しない部品を選択してください。

クランプ電圧をバス電圧より5～8%高く設定してください。この範囲であれば、過渡的なピーク電圧からコンデンサを保護しつつ、通常のパルス時にはダイオードが導通しないようにすることができます。

戦略5：寿命計算にリンギングテールを含める

ループパラメータからリンギング周波数、振幅、減衰率をモデル化し、次に部品のパルス寿命データを反転電圧と主パルスの両方に適用します。

累積応力が誘電疲労限界に達した時点で、メンテナンス間隔を設定してください。誘電疲労率が0.1%未満のN4700部品の場合、減衰は外部抵抗器によって発生し、これは設計者が制御するパラメータです。

戦略6：設計ではなく、組み立てを測定する

組み立てた回路に、200MHz以上の校正済み高電圧プローブと50MHz以上の電流センサを使用します。測定した立ち上がり時間、オーバーシュート、リンギングをモデル予測値と比較します。

両者の違いは、モデル化されていない寄生インダクタンスです。測定波形が一致するまでレイアウトを繰り返し調整し、試運転時の波形を後々のメンテナンスの基準として記録してください。

コンポーネントパラメータ	標準値	試験条件
定格電圧（HVCT8Gシリーズ）	10kV DC	60秒間、1.5倍の高電圧試験
キャパシタンス	4700 pF ±20% (472M)	1 MHz、1 V rms
1MHzにおけるESR	50 mΩ未満	-
ループインダクタンス（E40コード）	8 nH未満	端子間隔40mm
絶縁抵抗	500V DCで10GΩ以上	25℃、相対湿度60％
使用可能温度範囲	−40℃～+125℃	IEC 60068-2シリーズ
パルスdv/dt機能	50 kV/µs以上	定格電圧で

5. 波形整合性を確保するためのHVC N4700コンデンサ

このノードでの選択を左右する要件は4つあります。ループの上限に余裕を持たせるためにESLが十分に低いこと、ループの減衰が抵抗器から得られるように散逸係数が十分に低いこと、5%から8%のピークに耐えられるほど部分放電が十分に低いこと、そしてパルスエネルギーが繰り返されるほど静電容量が十分に安定していることです。HVCは、東莞にある6,000m²の自社工場で、1kVから150kVの範囲でこれらの要件を満たす製品を製造しています。

ここで重要な6つのパラメータ

• ラジアルリード、スクリュー端子、マルチ端子構成のいずれにおいても、ESLが30 nH未満であるため、ループ内のコンデンサの割合は140 nHの上限に対して小さく抑えられます。
• N4700 誘電率（DF）が0.1%未満の誘電体を使用すると、減衰に対する誘電体の寄与がなくなるため、減衰抵抗がループ抵抗を設定し、コンデンサはループ抵抗に影響を与えなくなります。
• 5 pC以下の100%部分放電試験は、寄生インダクタンスが各パルスに加える5%から8%の電圧ピークをカバーします。
• ±30 ppm/℃の温度係数により、熱過渡現象を通して静電容量が安定するため、½CV²に従うパルスエネルギーがショットごとに繰り返されます。
• HVRGHP ESLが10 nH以下のダンピング抵抗と、25 nsから35 nsの回復時間を持つ高速回復クランプダイオードは、コンデンサとともに、適切なダンピングおよびクランプ段を構成する。
• 40 kVまでのネジ端子ボディは、光源現場修理プログラムにおいて日本の村田製作所製ネジ式コンデンサの代替品として認定されています。HVC部品は、 村田TDKおよびVishayの高電圧シリーズ。

配送とサポート

標準部品は4～8週間、波形整合性確認済みのセットは6～10週間で出荷されます。HVCアプリケーションエンジニアリングでは、ループインダクタンスモデリング、ESLおよびESR測定、ダンピングおよびクランプ設計レビューをサポートします。

バス電圧、ステージ容量、目標立ち上がり時間、ピーク電流、およびレイアウト図をお送りください。HVCは、提案されたパッケージのESL値、ダンピング抵抗値、クランプレベル、および2つのサンプルからなる評価キットを5営業日以内に返送します。

6。 よくある質問

Q1：どの程度のオーバーシュートが予想されますか？

これは I_overshoot / I_ss = e^(−πζ / √(1 − ζ²)) に従うため、減衰比だけで決まります。ζ が 0.35 の場合、オーバーシュートは 30.9% で、16 kA の設計では 30 ns の間 20.9 kA に達します。直列減衰抵抗を使用して ζ を 0.6 に上げると、オーバーシュートは 9.5% に減少します。

Q2：30ナノ秒のフロントエンドには、どのくらいのループインダクタンスの上限が適用されますか？

L_loop_max = t_r² / (2 × C_stage × ζ²)。20 nF、30 ns、ζ = 0.4 の場合、140 nH になります。コンデンサ、スイッチバス、磁気巻線、ケーブルに天井値を分割し、完成したアセンブリを承認する前に測定します。

Q3：ループインダクタンスはどのようにしてコンデンサの電圧を上昇させるのですか？

V_cap(t) = V_bus + L_loop × dI/dt を介して。オーバーシュートのピークでは傾斜が 10 kA/ns に達するため、200 nH のループではバス上に 2 kV の過渡電圧が発生します。30 kV のバスでは、これは 20 ns の間 32 kV となり、過渡定格内ですが、誘電体が必要とする寿命マージンを超えています。

Q4：高いdV/dtはスイッチにどのような影響を与えますか？

出力容量を介してゲートに電流が流れます。133 V/ns、50 pFの場合、変位電流は6.65 Aとなり、ゲートインピーダンスが5 Ωであるため、33 Vの振幅となり、ゲート定格をはるかに超えます。これによりタイミングが狂い、下流の磁気段にジッタが発生します。

Q5：6kHzにおけるリンギングテールはなぜ重要なのでしょうか？

メンテナンス間隔の間に5万回繰り返されるため、ζ 0.4では、各ショットでピークの約28%の反転が加えられ、コンデンサの誘電体とスイッチ本体のダイオードに同時に負荷がかかります。テールからの累積疲労は、メインパルスからの疲労に匹敵します。

Q6：モデル化できなかった寄生インダクタンスはどのように求めればよいですか？

構築したアセンブリを200MHz以上のプローブと50MHz以上の電流センサで測定し、立ち上がり時間、オーバーシュート、リンギングをモデルと比較します。測定値と予測値の差はモデル化されていないインダクタンスであり、レイアウトによってその差が修正されます。

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